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   Register Declarations for the Cygnal/SiLabs C8051F02x Processor Range

   Copyright (C) 2004 - Maarten Brock, sourceforge.brock@dse.nl

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#ifndef C8051F020_H
#define C8051F020_H


/*  BYTE Registers  */
__sfr __at 0x80 P0       ;  /* PORT 0                                                  */
__sfr __at 0x81 SP       ;  /* STACK POINTER                                           */
__sfr __at 0x82 DPL      ;  /* DATA POINTER - LOW BYTE                                 */
__sfr __at 0x83 DPH      ;  /* DATA POINTER - HIGH BYTE                                */
__sfr __at 0x84 P4       ;  /* PORT 4                                                  */
__sfr __at 0x85 P5       ;  /* PORT 5                                                  */
__sfr __at 0x86 P6       ;  /* PORT 6                                                  */
__sfr __at 0x87 PCON     ;  /* POWER CONTROL                                           */
__sfr __at 0x88 TCON     ;  /* TIMER CONTROL                                           */
__sfr __at 0x89 TMOD     ;  /* TIMER MODE                                              */
__sfr __at 0x8A TL0      ;  /* TIMER 0 - LOW BYTE                                      */
__sfr __at 0x8B TL1      ;  /* TIMER 1 - LOW BYTE                                      */
__sfr __at 0x8C TH0      ;  /* TIMER 0 - HIGH BYTE                                     */
__sfr __at 0x8D TH1      ;  /* TIMER 1 - HIGH BYTE                                     */
__sfr __at 0x8E CKCON    ;  /* CLOCK CONTROL                                           */
__sfr __at 0x8F PSCTL    ;  /* PROGRAM STORE R/W CONTROL                               */
__sfr __at 0x90 P1       ;  /* PORT 1                                                  */
__sfr __at 0x91 TMR3CN   ;  /* TIMER 3 CONTROL                                         */
__sfr __at 0x92 TMR3RLL  ;  /* TIMER 3 RELOAD REGISTER - LOW BYTE                      */
__sfr __at 0x93 TMR3RLH  ;  /* TIMER 3 RELOAD REGISTER - HIGH BYTE                     */
__sfr __at 0x94 TMR3L    ;  /* TIMER 3 - LOW BYTE                                      */
__sfr __at 0x95 TMR3H    ;  /* TIMER 3 - HIGH BYTE                                     */
__sfr __at 0x96 P7       ;  /* PORT 7                                                  */
__sfr __at 0x98 SCON     ;  /* UART0 CONTROL                                           */
__sfr __at 0x98 SCON0    ;  /* UART0 CONTROL                                           */
__sfr __at 0x99 SBUF     ;  /* UART0 BUFFER                                            */
__sfr __at 0x99 SBUF0    ;  /* UART0 BUFFER                                            */
__sfr __at 0x9A SPI0CFG  ;  /* SERIAL PERIPHERAL INTERFACE 0 CONFIGURATION             */
__sfr __at 0x9B SPI0DAT  ;  /* SERIAL PERIPHERAL INTERFACE 0 DATA                      */
__sfr __at 0x9C ADC1     ;  /* ADC 1 DATA                                              */
__sfr __at 0x9D SPI0CKR  ;  /* SERIAL PERIPHERAL INTERFACE 0 CLOCK RATE CONTROL        */
__sfr __at 0x9E CPT0CN   ;  /* COMPARATOR 0 CONTROL                                    */
__sfr __at 0x9F CPT1CN   ;  /* COMPARATOR 1 CONTROL                                    */
__sfr __at 0xA0 P2       ;  /* PORT 2                                                  */
__sfr __at 0xA1 EMI0TC   ;  /* External Memory Timing Control                          */
__sfr __at 0xA3 EMI0CF   ;  /* EMIF CONFIGURATION                                      */
__sfr __at 0xA4 PRT0CF   ;  /* PORT 0 CONFIGURATION                                    */
__sfr __at 0xA4 P0MDOUT  ;  /* PORT 0 OUTPUT MODE CONFIGURATION                        */
__sfr __at 0xA5 PRT1CF   ;  /* PORT 1 CONFIGURATION                                    */
__sfr __at 0xA5 P1MDOUT  ;  /* PORT 1 OUTPUT MODE CONFIGURATION                        */
__sfr __at 0xA6 PRT2CF   ;  /* PORT 2 CONFIGURATION                                    */
__sfr __at 0xA6 P2MDOUT  ;  /* PORT 2 OUTPUT MODE CONFIGURATION                        */
__sfr __at 0xA7 PRT3CF   ;  /* PORT 3 CONFIGURATION                                    */
__sfr __at 0xA7 P3MDOUT  ;  /* PORT 3 OUTPUT MODE CONFIGURATION                        */
__sfr __at 0xA8 IE       ;  /* INTERRUPT ENABLE                                        */
__sfr __at 0xA9 SADDR0   ;  /* UART0 Slave Address                                     */
__sfr __at 0xAA ADC1CN   ;  /* ADC 1 CONTROL                                           */
__sfr __at 0xAB ADC1CF   ;  /* ADC 1 CONFIGURATION                                     */
__sfr __at 0xAC AMX1SL   ;  /* ADC 1 MUX CHANNEL SELECTION                             */
__sfr __at 0xAD P3IF     ;  /* PORT 3 EXTERNAL INTERRUPT FLAGS                         */
__sfr __at 0xAE SADEN1   ;  /* UART1 Slave Address Enable                              */
__sfr __at 0xAF EMI0CN   ;  /* EXTERNAL MEMORY INTERFACE CONTROL                       */
__sfr __at 0xAF _XPAGE ;    /* XDATA/PDATA PAGE                                        */
__sfr __at 0xB0 P3       ;  /* PORT 3                                                  */
__sfr __at 0xB1 OSCXCN   ;  /* EXTERNAL OSCILLATOR CONTROL                             */
__sfr __at 0xB2 OSCICN   ;  /* INTERNAL OSCILLATOR CONTROL                             */
__sfr __at 0xB5 P74OUT   ;  /* PORT 4 THROUGH 7 OUTPUT MODE CONFIGURATION              */
__sfr __at 0xB6 FLSCL    ;  /* FLASH MEMORY TIMING PRESCALER                           */
__sfr __at 0xB7 FLACL    ;  /* FLASH ACESS LIMIT                                       */
__sfr __at 0xB8 IP       ;  /* INTERRUPT PRIORITY                                      */
__sfr __at 0xB9 SADEN0   ;  /* UART0 Slave Address Enable                              */
__sfr __at 0xBA AMX0CF   ;  /* ADC 0 MUX CONFIGURATION                                 */
__sfr __at 0xBB AMX0SL   ;  /* ADC 0 MUX CHANNEL SELECTION                             */
__sfr __at 0xBC ADC0CF   ;  /* ADC 0 CONFIGURATION                                     */
__sfr __at 0xBD P1MDIN   ;  /* PORT 1 Input Mode                                       */
__sfr __at 0xBE ADC0L    ;  /* ADC 0 DATA - LOW BYTE                                   */
__sfr __at 0xBF ADC0H    ;  /* ADC 0 DATA - HIGH BYTE                                  */
__sfr __at 0xC0 SMB0CN   ;  /* SMBUS 0 CONTROL                                         */
__sfr __at 0xC1 SMB0STA  ;  /* SMBUS 0 STATUS                                          */
__sfr __at 0xC2 SMB0DAT  ;  /* SMBUS 0 DATA                                            */
__sfr __at 0xC3 SMB0ADR  ;  /* SMBUS 0 SLAVE ADDRESS                                   */
__sfr __at 0xC4 ADC0GTL  ;  /* ADC 0 GREATER-THAN REGISTER - LOW BYTE                  */
__sfr __at 0xC5 ADC0GTH  ;  /* ADC 0 GREATER-THAN REGISTER - HIGH BYTE                 */
__sfr __at 0xC6 ADC0LTL  ;  /* ADC 0 LESS-THAN REGISTER - LOW BYTE                     */
__sfr __at 0xC7 ADC0LTH  ;  /* ADC 0 LESS-THAN REGISTER - HIGH BYTE                    */
__sfr __at 0xC8 T2CON    ;  /* TIMER 2 CONTROL                                         */
__sfr __at 0xC9 T4CON    ;  /* TIMER 4 CONTROL                                         */
__sfr __at 0xCA RCAP2L   ;  /* TIMER 2 CAPTURE REGISTER - LOW BYTE                     */
__sfr __at 0xCB RCAP2H   ;  /* TIMER 2 CAPTURE REGISTER - HIGH BYTE                    */
__sfr __at 0xCC TL2      ;  /* TIMER 2 - LOW BYTE                                      */
__sfr __at 0xCD TH2      ;  /* TIMER 2 - HIGH BYTE                                     */
__sfr __at 0xCF SMB0CR   ;  /* SMBUS 0 CLOCK RATE                                      */
__sfr __at 0xD0 PSW      ;  /* PROGRAM STATUS WORD                                     */
__sfr __at 0xD1 REF0CN   ;  /* VOLTAGE REFERENCE 0 CONTROL                             */
__sfr __at 0xD2 DAC0L    ;  /* DAC 0 REGISTER - LOW BYTE                               */
__sfr __at 0xD3 DAC0H    ;  /* DAC 0 REGISTER - HIGH BYTE                              */
__sfr __at 0xD4 DAC0CN   ;  /* DAC 0 CONTROL                                           */
__sfr __at 0xD5 DAC1L    ;  /* DAC 1 REGISTER - LOW BYTE                               */
__sfr __at 0xD6 DAC1H    ;  /* DAC 1 REGISTER - HIGH BYTE                              */
__sfr __at 0xD7 DAC1CN   ;  /* DAC 1 CONTROL                                           */
__sfr __at 0xD8 PCA0CN   ;  /* PCA 0 COUNTER CONTROL                                   */
__sfr __at 0xD9 PCA0MD   ;  /* PCA 0 COUNTER MODE                                      */
__sfr __at 0xDA PCA0CPM0 ;  /* CONTROL REGISTER FOR PCA 0 MODULE 0                     */
__sfr __at 0xDB PCA0CPM1 ;  /* CONTROL REGISTER FOR PCA 0 MODULE 1                     */
__sfr __at 0xDC PCA0CPM2 ;  /* CONTROL REGISTER FOR PCA 0 MODULE 2                     */
__sfr __at 0xDD PCA0CPM3 ;  /* CONTROL REGISTER FOR PCA 0 MODULE 3                     */
__sfr __at 0xDE PCA0CPM4 ;  /* CONTROL REGISTER FOR PCA 0 MODULE 4                     */
__sfr __at 0xE0 ACC      ;  /* ACCUMULATOR                                             */
__sfr __at 0xE1 XBR0     ;  /* DIGITAL CROSSBAR CONFIGURATION REGISTER 0               */
__sfr __at 0xE2 XBR1     ;  /* DIGITAL CROSSBAR CONFIGURATION REGISTER 1               */
__sfr __at 0xE3 XBR2     ;  /* DIGITAL CROSSBAR CONFIGURATION REGISTER 2               */
__sfr __at 0xE4 RCAP4L   ;  /* TIMER 4 CAPTURE REGISTER - LOW BYTE                     */
__sfr __at 0xE5 RCAP4H   ;  /* TIMER 4 CAPTURE REGISTER - HIGH BYTE                    */
__sfr __at 0xE6 EIE1     ;  /* EXTERNAL INTERRUPT ENABLE 1                             */
__sfr __at 0xE7 EIE2     ;  /* EXTERNAL INTERRUPT ENABLE 2                             */
__sfr __at 0xE8 ADC0CN   ;  /* ADC 0 CONTROL                                           */
__sfr __at 0xE9 PCA0L    ;  /* PCA 0 TIMER - LOW BYTE                                  */
__sfr __at 0xEA PCA0CPL0 ;  /* CAPTURE/COMPARE REGISTER FOR PCA 0 MODULE 0 - LOW BYTE  */
__sfr __at 0xEB PCA0CPL1 ;  /* CAPTURE/COMPARE REGISTER FOR PCA 0 MODULE 1 - LOW BYTE  */
__sfr __at 0xEC PCA0CPL2 ;  /* CAPTURE/COMPARE REGISTER FOR PCA 0 MODULE 2 - LOW BYTE  */
__sfr __at 0xED PCA0CPL3 ;  /* CAPTURE/COMPARE REGISTER FOR PCA 0 MODULE 3 - LOW BYTE  */
__sfr __at 0xEE PCA0CPL4 ;  /* CAPTURE/COMPARE REGISTER FOR PCA 0 MODULE 4 - LOW BYTE  */
__sfr __at 0xEF RSTSRC   ;  /* RESET SOURCE                                            */
__sfr __at 0xF0 B        ;  /* B REGISTER                                              */
__sfr __at 0xF1 SCON1    ;  /* UART1 CONTROL                                           */
__sfr __at 0xF2 SBUF1    ;  /* UART1 DATA                                              */
__sfr __at 0xF3 SADDR1   ;  /* UART1 Slave Address                                     */
__sfr __at 0xF4 TL4      ;  /* TIMER 4 DATA - LOW BYTE                                 */
__sfr __at 0xF5 TH4      ;  /* TIMER 4 DATA - HIGH BYTE                                */
__sfr __at 0xF6 EIP1     ;  /* EXTERNAL INTERRUPT PRIORITY REGISTER 1                  */
__sfr __at 0xF7 EIP2     ;  /* EXTERNAL INTERRUPT PRIORITY REGISTER 2                  */
__sfr __at 0xF8 SPI0CN   ;  /* SERIAL PERIPHERAL INTERFACE 0 CONTROL                   */
__sfr __at 0xF9 PCA0H    ;  /* PCA 0 TIMER - HIGH BYTE                                 */
__sfr __at 0xFA PCA0CPH0 ;  /* CAPTURE/COMPARE REGISTER FOR PCA 0 MODULE 0 - HIGH BYTE */
__sfr __at 0xFB PCA0CPH1 ;  /* CAPTURE/COMPARE REGISTER FOR PCA 0 MODULE 1 - HIGH BYTE */
__sfr __at 0xFC PCA0CPH2 ;  /* CAPTURE/COMPARE REGISTER FOR PCA 0 MODULE 2 - HIGH BYTE */
__sfr __at 0xFD PCA0CPH3 ;  /* CAPTURE/COMPARE REGISTER FOR PCA 0 MODULE 3 - HIGH BYTE */
__sfr __at 0xFE PCA0CPH4 ;  /* CAPTURE/COMPARE REGISTER FOR PCA 0 MODULE 4 - HIGH BYTE */
__sfr __at 0xFF WDTCN    ;  /* WATCHDOG TIMER CONTROL                                  */


/*  BIT Registers  */

/*  P0  0x80 */
__sbit __at 0x80 P0_0    ;
__sbit __at 0x81 P0_1    ;
__sbit __at 0x82 P0_2    ;
__sbit __at 0x83 P0_3    ;
__sbit __at 0x84 P0_4    ;
__sbit __at 0x85 P0_5    ;
__sbit __at 0x86 P0_6    ;
__sbit __at 0x87 P0_7    ;

/*  TCON  0x88 */
__sbit __at 0x88 IT0     ;  /* EXT. INTERRUPT 0 TYPE                        */
__sbit __at 0x89 IE0     ;  /* EXT. INTERRUPT 0 EDGE FLAG                   */
__sbit __at 0x8A IT1     ;  /* EXT. INTERRUPT 1 TYPE                        */
__sbit __at 0x8B IE1     ;  /* EXT. INTERRUPT 1 EDGE FLAG                   */
__sbit __at 0x8C TR0     ;  /* TIMER 0 ON/OFF CONTROL                       */
__sbit __at 0x8D TF0     ;  /* TIMER 0 OVERFLOW FLAG                        */
__sbit __at 0x8E TR1     ;  /* TIMER 1 ON/OFF CONTROL                       */
__sbit __at 0x8F TF1     ;  /* TIMER 1 OVERFLOW FLAG                        */

/*  P1  0x90 */
__sbit __at 0x90 P1_0    ;
__sbit __at 0x91 P1_1    ;
__sbit __at 0x92 P1_2    ;
__sbit __at 0x93 P1_3    ;
__sbit __at 0x94 P1_4    ;
__sbit __at 0x95 P1_5    ;
__sbit __at 0x96 P1_6    ;
__sbit __at 0x97 P1_7    ;

/*  SCON  0x98 */
__sbit __at 0x98 RI      ;  /* SCON.0 - RECEIVE INTERRUPT FLAG              */
__sbit __at 0x98 RI0     ;  /* SCON.0 - RECEIVE INTERRUPT FLAG              */
__sbit __at 0x99 TI      ;  /* SCON.1 - TRANSMIT INTERRUPT FLAG             */
__sbit __at 0x99 TI0     ;  /* SCON.1 - TRANSMIT INTERRUPT FLAG             */
__sbit __at 0x9A RB8     ;  /* SCON.2 - RECEIVE BIT 8                       */
__sbit __at 0x9A RB80    ;  /* SCON.2 - RECEIVE BIT 8                       */
__sbit __at 0x9B TB8     ;  /* SCON.3 - TRANSMIT BIT 8                      */
__sbit __at 0x9B TB80    ;  /* SCON.3 - TRANSMIT BIT 8                      */
__sbit __at 0x9C REN     ;  /* SCON.4 - RECEIVE ENABLE                      */
__sbit __at 0x9C REN0    ;  /* SCON.4 - RECEIVE ENABLE                      */
__sbit __at 0x9D SM2     ;  /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */
__sbit __at 0x9D SM20    ;  /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */
__sbit __at 0x9D MCE0    ;  /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */
__sbit __at 0x9E SM1     ;  /* SCON.6 - SERIAL MODE CONTROL BIT 1           */
__sbit __at 0x9E SM10    ;  /* SCON.6 - SERIAL MODE CONTROL BIT 1           */
__sbit __at 0x9F SM0     ;  /* SCON.7 - SERIAL MODE CONTROL BIT 0           */
__sbit __at 0x9F SM00    ;  /* SCON.7 - SERIAL MODE CONTROL BIT 0           */
__sbit __at 0x9F S0MODE  ;  /* SCON.7 - SERIAL MODE CONTROL BIT 0           */

/*  P2  0xA0 */
__sbit __at 0xA0 P2_0    ;
__sbit __at 0xA1 P2_1    ;
__sbit __at 0xA2 P2_2    ;
__sbit __at 0xA3 P2_3    ;
__sbit __at 0xA4 P2_4    ;
__sbit __at 0xA5 P2_5    ;
__sbit __at 0xA6 P2_6    ;
__sbit __at 0xA7 P2_7    ;

/*  IE  0xA8 */
__sbit __at 0xA8 EX0     ;  /* EXTERNAL INTERRUPT 0 ENABLE               */
__sbit __at 0xA9 ET0     ;  /* TIMER 0 INTERRUPT ENABLE                  */
__sbit __at 0xAA EX1     ;  /* EXTERNAL INTERRUPT 1 ENABLE               */
__sbit __at 0xAB ET1     ;  /* TIMER 1 INTERRUPT ENABLE                  */
__sbit __at 0xAC ES      ;  /* SERIAL PORT 0 INTERRUPT ENABLE            */
__sbit __at 0xAC ES0     ;  /* SERIAL PORT 0 INTERRUPT ENABLE            */
__sbit __at 0xAD ET2     ;  /* TIMER 2 INTERRUPT ENABLE                  */
__sbit __at 0xAF EA      ;  /* GLOBAL INTERRUPT ENABLE                   */

/*  P3  0xB0 */
__sbit __at 0xB0 P3_0    ;
__sbit __at 0xB1 P3_1    ;
__sbit __at 0xB2 P3_2    ;
__sbit __at 0xB3 P3_3    ;
__sbit __at 0xB4 P3_4    ;
__sbit __at 0xB5 P3_5    ;
__sbit __at 0xB6 P3_6    ;
__sbit __at 0xB7 P3_7    ;

/*  IP  0xB8 */
__sbit __at 0xB8 PX0     ;  /* EXTERNAL INTERRUPT 0 PRIORITY             */
__sbit __at 0xB9 PT0     ;  /* TIMER 0 PRIORITY                          */
__sbit __at 0xBA PX1     ;  /* EXTERNAL INTERRUPT 1 PRIORITY             */
__sbit __at 0xBB PT1     ;  /* TIMER 1 PRIORITY                          */
__sbit __at 0xBC PS      ;  /* SERIAL PORT PRIORITY                      */
__sbit __at 0xBD PT2     ;  /* TIMER 2 PRIORITY                          */

/*  SMB0CN  0xC0 */
__sbit __at 0xC0 SMBTOE  ;  /* SMBUS 0 TIMEOUT ENABLE                    */
__sbit __at 0xC1 SMBFTE  ;  /* SMBUS 0 FREE TIMER ENABLE                 */
__sbit __at 0xC2 AA      ;  /* SMBUS 0 ASSERT/ACKNOWLEDGE FLAG           */
__sbit __at 0xC3 SI      ;  /* SMBUS 0 INTERRUPT PENDING FLAG            */
__sbit __at 0xC4 STO     ;  /* SMBUS 0 STOP FLAG                         */
__sbit __at 0xC5 STA     ;  /* SMBUS 0 START FLAG                        */
__sbit __at 0xC6 ENSMB   ;  /* SMBUS 0 ENABLE                            */
__sbit __at 0xC7 BUSY    ;  /* SMBUS 0 BUSY                              */

/*  T2CON  0xC8 */
__sbit __at 0xC8 CPRL2   ;  /* CAPTURE OR RELOAD SELECT                  */
__sbit __at 0xC9 CT2     ;  /* TIMER OR COUNTER SELECT                   */
__sbit __at 0xCA TR2     ;  /* TIMER 2 ON/OFF CONTROL                    */
__sbit __at 0xCB EXEN2   ;  /* TIMER 2 EXTERNAL ENABLE FLAG              */
__sbit __at 0xCC TCLK    ;  /* TRANSMIT CLOCK FLAG                       */
__sbit __at 0xCD RCLK    ;  /* RECEIVE CLOCK FLAG                        */
__sbit __at 0xCE EXF2    ;  /* EXTERNAL FLAG                             */
__sbit __at 0xCF TF2     ;  /* TIMER 2 OVERFLOW FLAG                     */

/*  PSW  0xD0 */
__sbit __at 0xD0 P       ;  /* ACCUMULATOR PARITY FLAG                   */
__sbit __at 0xD1 F1      ;  /* USER FLAG 1                               */
__sbit __at 0xD2 OV      ;  /* OVERFLOW FLAG                             */
__sbit __at 0xD3 RS0     ;  /* REGISTER BANK SELECT 0                    */
__sbit __at 0xD4 RS1     ;  /* REGISTER BANK SELECT 1                    */
__sbit __at 0xD5 F0      ;  /* USER FLAG 0                               */
__sbit __at 0xD6 AC      ;  /* AUXILIARY CARRY FLAG                      */
__sbit __at 0xD7 CY      ;  /* CARRY FLAG                                */

/*  PCA0CN  0xD8H */
__sbit __at 0xD8 CCF0    ;  /* PCA 0 MODULE 0 INTERRUPT FLAG             */
__sbit __at 0xD9 CCF1    ;  /* PCA 0 MODULE 1 INTERRUPT FLAG             */
__sbit __at 0xDA CCF2    ;  /* PCA 0 MODULE 2 INTERRUPT FLAG             */
__sbit __at 0xDB CCF3    ;  /* PCA 0 MODULE 3 INTERRUPT FLAG             */
__sbit __at 0xDC CCF4    ;  /* PCA 0 MODULE 4 INTERRUPT FLAG             */
__sbit __at 0xDE CR      ;  /* PCA 0 COUNTER RUN CONTROL BIT             */
__sbit __at 0xDF CF      ;  /* PCA 0 COUNTER OVERFLOW FLAG               */

/*  ADC0CN  0xE8H */
__sbit __at 0xE8 ADLJST  ;  /* ADC 0 RIGHT JUSTIFY DATA BIT              */
__sbit __at 0xE8 AD0LJST ;  /* ADC 0 RIGHT JUSTIFY DATA BIT              */
__sbit __at 0xE9 ADWINT  ;  /* ADC 0 WINDOW COMPARE INTERRUPT FLAG       */
__sbit __at 0xE9 AD0WINT ;  /* ADC 0 WINDOW COMPARE INTERRUPT FLAG       */
__sbit __at 0xEA ADSTM0  ;  /* ADC 0 START OF CONVERSION MODE BIT 0      */
__sbit __at 0xEA AD0CM0  ;  /* ADC 0 START OF CONVERSION MODE BIT 0      */
__sbit __at 0xEB ADSTM1  ;  /* ADC 0 START OF CONVERSION MODE BIT 1      */
__sbit __at 0xEB AD0CM1  ;  /* ADC 0 START OF CONVERSION MODE BIT 1      */
__sbit __at 0xEC ADBUSY  ;  /* ADC 0 BUSY FLAG                           */
__sbit __at 0xEC AD0BUSY ;  /* ADC 0 BUSY FLAG                           */
__sbit __at 0xED ADCINT  ;  /* ADC 0 CONVERISION COMPLETE INTERRUPT FLAG */
__sbit __at 0xED AD0INT  ;  /* ADC 0 CONVERISION COMPLETE INTERRUPT FLAG */
__sbit __at 0xEE ADCTM   ;  /* ADC 0 TRACK MODE                          */
__sbit __at 0xEE AD0TM   ;  /* ADC 0 TRACK MODE                          */
__sbit __at 0xEF ADCEN   ;  /* ADC 0 ENABLE                              */
__sbit __at 0xEF AD0EN   ;  /* ADC 0 ENABLE                              */

/*  SPI0CN  0xF8H */
__sbit __at 0xF8 SPIEN   ;  /* SPI 0 SPI ENABLE                          */
__sbit __at 0xF9 MSTEN   ;  /* SPI 0 MASTER ENABLE                       */
__sbit __at 0xFA SLVSEL  ;  /* SPI 0 SLAVE SELECT                        */
__sbit __at 0xFB TXBSY   ;  /* SPI 0 TX BUSY FLAG                        */
__sbit __at 0xFC RXOVRN  ;  /* SPI 0 RX OVERRUN FLAG                     */
__sbit __at 0xFD MODF    ;  /* SPI 0 MODE FAULT FLAG                     */
__sbit __at 0xFE WCOL    ;  /* SPI 0 WRITE COLLISION FLAG                */
__sbit __at 0xFF SPIF    ;  /* SPI 0 INTERRUPT FLAG                      */


/* Predefined SFR Bit Masks */

#define IDLE    0x01    /* PCON */
#define STOP    0x02    /* PCON */
#define SMOD0   0x80    /* PCON */
#define TF3     0x80    /* TMR3CN */
#define CPFIF   0x10    /* CPTnCN */
#define CPRIF   0x20    /* CPTnCN */
#define CPOUT   0x40    /* CPTnCN */
#define TR4     0x04    /* T4CON */
#define TF4     0x80    /* T4CON */
#define ECCF    0x01    /* PCA0CPMn */
#define PWM     0x02    /* PCA0CPMn */
#define TOG     0x04    /* PCA0CPMn */
#define MAT     0x08    /* PCA0CPMn */
#define CAPN    0x10    /* PCA0CPMn */
#define CAPP    0x20    /* PCA0CPMn */
#define ECOM    0x40    /* PCA0CPMn */
#define PWM16   0x80    /* PCA0CPMn */
#define PORSF   0x02    /* RSTSRC */
#define SWRSF   0x10    /* RSTSRC */
#define RI1     0x01    /* SCON1 */
#define TI1     0x02    /* SCON1 */
#define RB81    0x04    /* SCON1 */
#define TB81    0x08    /* SCON1 */
#define REN1    0x10    /* SCON1 */
#define SM21    0x20    /* SCON1 */
#define SM11    0x40    /* SCON1 */
#define SM01    0x80    /* SCON1 */

#endif
